Description
Lista de características detalladas
ARMv7 Cortex-A9 CPU(s)
El núcleo de ARMv7 es compatible con las siguientes características:
• 88F F F68286810/886820/88hasta 1.866 GHz
• 88F6811/88F6821-hasta 1,33 GHz CPU clock
• 88F6W21 de 1.2 GHz CPU clock
• Arquitectura superescalar CPU RISC con arquitectura de Harvard, de longitud variable, fuera de proceso de venta
• Co-procesador SIMD de neón para mejorar el procesamiento de señal
• Instrucciones de DSP para aumentar el rendimiento para multimedia y algoritmos de procesamiento de señal
• Conjunto de instrucciones de 32 bits para alto rendimiento y flexibilidad
• El pulgar-2 y pulgar-EE para el conjunto de instrucciones de la densidad del código
• Solo / Unidad de coma flotante de doble precisión (FPU)
• El multiprocesamiento simétrico (SMP) y multiprocesamiento asimétrico (AMP) modos
• 32 KB de caché L1 de instrucción 4 vías, asociativo, prácticamente indexada, etiquetados físicamente, la paridad protegido
• 32 KB de caché de datos L1, de 4 vías, asociativa, indexados físicamente, físicamente con la etiqueta, la paridad protegido
• Prefetch de L1:
-- Software impulsado mediante instrucciones PLD BRAZO
-- Prefetcher de hardware que controla hasta 2 flujos de datos
• El cuadro Look-ahead Buffer (TLB):
-- Micro TLB: dos de 64-entrada totalmente asociativo para instrucciones y memorias caché de datos
-- Macro TLB: 512 2 vías de entrada de estructura asociativa
• Plan de coherencia de caché MESI
• Golpear en miss y múltiples peticiones pendientes
• La canalización de 8 etapas
• Orden de ejecución de un mayor rendimiento
• La unidad de predicción de bifurcación:
--- 2-way sucursal dirección de destino de caché (BTAC) de 4096 entradas
-- La historia mundial Buffer (GHB) con 16K 2 bits predictores
-- Devuelve Pila con ocho entradas de 32 bits
• 64 bits del bus de datos interna con la carga de 64 bits / almacenar instrucciones
• Opciones Endianess-Little Endian o mixtos
• La unidad de monitor de rendimiento (PMU) que cuenta hasta 6 tipos de evento
• Compatible con el brazo/JTAG ICE y el Módulo de Seguimiento Integrado (ETM) para mejorar la capacidad de depuración en tiempo real.
Unified Caché de nivel 2
• El 16, 1024 KB, reescritura y de escritura a través de la cache
• Indexados físicamente etiquetadas físicamente (PIPT)
• No bloquear oleoducto admite múltiples solicitudes pendientes y golpear en Miss(HUM)
• El bloqueo/modo de bloqueo de los datos e instrucciones de la línea o ID maestro
• Protección de paridad
La memoria DDR3 DDR3L / / Controlador de memoria SDRAM DDR4.
• 16/32 bits, con un Error-Correcting Code (ECC) opción apoyada tanto por los anchos de interfaz
• 88F F F68286810/886820/88-Soporta memoria DDR3/DDR3L y DDR4-1800-1600/1866
• 88F6811/88F6821-Soporta memoria DDR3/DDR3L-1333
• 88F6W21-soporta DDR3 DDR3/L-1200
• Admite reloj sincrónica de 1:N y las 2:N entre los núcleos de CPU y la interfaz de memoria DRAM
• Compatible con frecuencias de reloj asincrónica entre los núcleos de CPU y la interfaz de memoria DRAM
• Compatible con 1.5 y 1.35V para DDR3 (SSTL) y 1,2V para DDR4 (POD1)
• Programador inteligente para la transacción es reordenar y QoS
• La calibración automática de impedancia de salida de E/S.
• Hasta 8 GB de memoria DDR3 y 16 Gb de memoria DDR4 (compatible con todos los dispositivos de memoria DDR de densidad, según el estándar JEDEC)
• La memoria DDR3/DDR4 de soporte de nivelación de la lectura y escritura
• Datos Privados y patrón de ojo de control de proceso de optimización para mejorar la integridad de señal
• Compatibilidad con la duplicación de direcciones de memoria DDR3
• Soporta memoria DDR3/BL8 DDR4.
• Compatible con el 2T y 3T para permitir a los modos de operación de alta frecuencia, incluso en una configuración de carga pesada
• Admite el intercalado de banco de SDRAM
• 8/16 páginas abiertas por rank (DDR3 y DDR4, respectivamente)
• Hasta una ráfaga de 128 bytes de memoria por una única
• Compatible con x8 y dispositivos de memoria x16
• Admite las siguientes características: DDR4.
-- La memoria DDR4 PDA (por la DRAM Accesibilidad)
-- La lectura de la Sra. DDR4.
-- La memoria DDR4 diferentes intervalos del grupo del banco
-- Es compatible con la asignación de pines distintas para DDR3/DDR4 de la optimización de rutas de la junta
Gigabit Ethernet (GbE)
• 88F6810
--- 2 GbE (0 y 1)
-- SGMII / RGMII / interfaz MII
• 88F6820/88F6828
-- 3 GbE (0-2)
-- SGMII RGMII QSGMII / / / interfaz MII
• 88F F F66821/886811/88W21
--- 2 GbE (0 y 1)
-- SGMII / RGMII / interfaz MII
• Admite SGMII/1000/2500 de 10/100 Mbps
• Velocidad de cable completo recibir y transmitir paquetes cortos
• Compatible con IEEE 1588v2 (PTP).
• Filtrado DA
• Prioridad estricta/WRR arbitraje entre el 8 de colas de transmisión con limitación de velocidad
• Por la conformación de la tasa de salida de la cola
• Apoyo para la cola sobre la base de la etiqueta de DSA de Marvell®
• Soporte para Jumbo Frames (hasta 10K) en recibir y transmitir
• La aceleración de la suma de comprobación de TCP/IP
• Compatible con IEEE 802.3az (Ethernet) con ahorro energético.
• Soporte de Wake-On-LAN.
Administración del búfer de hardware
• 4 piscinas de búfer independientes
• Hasta 64 KB elementos por piscina
• Los motores de DMA dedicado para lectura anticipada o reescritura desde/a la memoria externa
PCI Express (PCIe) Interfaz
• 88F F F68216810/886811/88-admite 3 puertos x1 carriles
• 88F6W21-Soporta 2 puertos x1 carriles
• 88F6820/88F6828-Admite 1 puerto x4 carriles y otros 2 puertos x1 carril o hasta 4 puertos x1 Lane
• Generación de PCIe 1.1 a 2.5 Gbps / Gen 2.0 a 5 Gbps signaling
• Admite causas complejas y modos de Endpoint
• Lane inversión de polaridad/inversión apoyo
• Tamaño de la carga máxima de 128 bytes
• Solo el canal virtual (VC-0)
• Soporte de buffer de reproducción
• Espacio de configuración de PCIe ampliada
• Gestión de energía: L0s L1 y ASPM potencia activa el apoyo del Estado; el software L1 y L2
• Apoyar el mensaje de error
• Maestro de PCIe características:
-- Host PCIe puente-traduce los ciclos de CPU a la memoria de PCIe o ciclos de configuración
-- Es compatible con el DMA estalla entre la memoria y PCIe
-- Admite hasta 4 transacciones pendientes de leer
-- Solicitud de lectura máxima de hasta 128 bytes
• El objetivo de PCIe características:
-- Es compatible con la recepción de solicitudes de lectura de hasta 8
-- Solicitud de lectura máxima de hasta 4 KB
-- Admite PCIe para acceder al dispositivo espacio interno y externo
Integrado de alta velocidad SERDES carriles
• 88F6810-Integra 5 baja potencia, de alta velocidad SERDES PHYs, basada en la probada tecnología Marvell SERDES
• 88F F F66821/886811/88W21-Integra 4 baja potencia, de alta velocidad SERDES PHYs, basada en la probada tecnología Marvell SERDES
• 88F6820/88F6828-Integra 6 de baja potencia, de alta velocidad SERDES PHYs, basada en la probada tecnología Marvell SERDES
• Diversas opciones de multiplexado de PCIe 3.0, SATA, QSGMII SGMII, y las interfaces USB 3.0
Los controladores USB
• 88F F F6828-36810/886820/88puertos USB configurable desde las 4 siguientes USBcontrollers:
-- 2 USB 3.0/2.0 puertos compatibles con el host integrado con el FIS.
-- 1 puerto compatible con dispositivos USB 3.0 integrado con el FIS.
-- 1 USB 2.0 host o puerto compatible con dispositivos integrado con el Fís.
• 88F F6821-26811/88puertos USB configurable desde las siguientes 3 controladores USB:
-- 2 USB 3.0/2.0 puertos compatibles con el host integrado con el FIS.
-- 88F F6821-16811/88puerto compatible con dispositivos USB 3.0 integrado con el FIS.
• Como Host:
-- Extensible Host Controller Interface (xHCI) compatible con
- Admite la conexión directa a todos los tipos de dispositivo (SS, SA, la FS, LS)
-- 64/16 admite hasta extremos independiente (USB 3.0 y USB 2.0, respectivamente)
• Como un dispositivo:
-- Se conecta a todos los tipos de host (SS, SA, FS) y hubs
-- Admite hasta 16/4 extremos independiente (USB 3.0 y USB 2.0, respectivamente)
• Admite el control, interrumpir, a granel, y las transferencias de datos isócrono
• USB Power Management:
-- U0 (activo), U1 (inactivo), U2 (Deep ralentí) y U3 (suspendido) para USB 3.0
-- Suspender y Reiniciar para USB 2.0
2 de 6 Gbps de Marvell® (Gen 3x) Los puertos SATA 3.0
• 88F F6820-26810/88totalmente compatibles con los puertos SATA 3.0
• 88F6828-4 totalmente compatibles con los puertos SATA 3.0
• 88F F6821-26811/88totalmente compatibles con los puertos SATA 3.0
• 88F6W21-1 totalmente compatibles con puertos SATA 3.0
• Soporta comunicaciones velocidades de 6.0 Gbps, 3.0 Gbps, y 1,5 Gbps
• Admite Gen Gen 1x, 2x, Gen 3
• Compatible con los niveles de señal del transmisor programable
• Admite Native Command Queuing (NCQ) y la primera parte FPDAM (DMA) con hasta 32 comandos pendientes por puerto.
• Admite AHCI 1.0 y las interfaces de programación IDE
• Admite multiplicador de puertos (PM) actúa FIS-Based-Switching definidos en el grupo de trabajo SATA definición PM
• Selección de puerto (PS): Cuestiones basado en el protocolo fuera de banda (OOB) secuencia para seleccionar el puerto de host activos
• Compatible con SATA externo (eSATA)
• Compatible con la administración de energía de dormitado parcial y de los estados
• Avanzada interrumpir la coalescencia
• Diagnóstico de mando avanzado a través de la ATA comando inteligente
2 Motores criptográficos
• La implementación del hardware de cifrado/descifrado y motores de autenticación para aumentar la seguridad IP (IPsec) y el cifrado/descifrado de archivos
• DMA dedicada a alimentar el motor de hardware con datos de la memoria SRAM interna o desde la memoria DDR
• Implementa AES, DES y algoritmos de cifrado 3DES.
• Implementa SHA2, SHA1, y algoritmos de autenticación MD5
XOR 4 Motores DMA
• RAID5 P (XOR paridad) generar y reparación de hasta 8 bloques de la fuente
• RAID6 P y Q generar y reparación de hasta 8 bloques de la fuente
• Copia de memoria (DMA) la aceleración
• Cálculo de iSCSI CRC-32
• Función de inicialización de la memoria
Controlador de la TDM
• Admite 2 canales VoIP independiente
• Interfaz genérica a la norma SLIC / SLAC / DAA / codec dispositivos
• Compatible con formatos estándar de la autopista PCM
• Soporta diferentes tipos de reloj de bits (256 kHz a 8.192 MHz en incrementos de los poderes de 2).
I2S Entrada/salida y salida S/PDIF Audio Interfaces
• Velocidades de muestreo de 44.1, 48 y 96 kHz.
• Compatible con IEC 60958-1, 60958-3, y las especificaciones de 61937
• Admite plain I2S, a la derecha, y justificado a la izquierda formatos
Controladora de Bus de dispositivo
• 8/16 bits multiplexar dirección / bus de datos
• Admite diferentes tipos de dispositivos de memoria estándar, como tampoco el flash y ROM
• Hasta 5 chip selecciona con programación de fechas
Controlador de memoria Flash NAND
• Soporte nativo para flash NAND con:
-- 8 KB de tamaño de página
-- ECC de 16 bits por página
• 4 chip selecciona con programación de fechas y opcional externo de control del estado de espera
2 puertos de SPI
• Objetivo general 1 bits de la interfaz SPI
• Puerto SPI dispone de hasta 4 chip selecciona
SD/ SDIO/ MMC/ Interfaz de host eMMC
• 1-bit / 4 bits SDmem, SDIO 3.0
• 1-bits / 8 / 4 bits, bits de MMC 4.4 para eMMC
• SDR-50: hasta 100 MHz
• El HS-DDR: hasta 50 MHz
• Hardware generar/verificar CRC en todos los comandos y las transacciones de datos de la tarjeta bus
2 interfaces UART
• UART 16750 compatible
• Cada puerto tiene:
--- 2 pines para las operaciones de transmisión y recepción
--- 2 pines para las funciones de control del módem
Gestión avanzada de energía
• Gestión de la potencia de CPU dice:
-- Profunda de la CPU Idle (apagado)
-- Idle (reloj de CPU)
-- Mariposa (reducción de la velocidad de CPU)
-- Ejecutar (CPU toda velocidad).
• En Espera con reloj en tiempo real (RTC) de la alarma o externos opciones de Wake-up
• Wake-On-LAN (WOL) sin pérdida de la recepción de paquetes
• Actualización automática de SDRAM y modos de Apagado
• Reloj seleccionable de diferentes interfaces
• PCIe, SGMII, USB, y SATA SERDES shutdown
• Ahorro de energía de Ethernet (EEE)
• Las distintas opciones de Wake-up
2 interfaces I2C
• Objetivo General I2C en los puertos de maestro/esclavo
• Soporte de inicialización de la serie de la EEPROM
Reloj en tiempo real
• El sistema externo wake-up
• Copia de seguridad de la batería
BootROM integrado
• Arrancar desde Flash (SPI, ni en paralelo, en paralelo, serie NY NY (SPI-NY), y SDIO/ MMC/ eMMC)
• Arrancar desde el PCIe o SATA
• Flujo de arranque seguro
2 Caída baja integrado (LDO) controlador
• On-chip controlador LDO Positive-Negative externos positivos (transistores PNP)
• Las tensiones de salida programables de 1.8/2.5V con 50 mV de resolución.
Los pasadores de multiuso (MPP)
• 88F F F6828-606810/886820/88MPP pines dedicados a funciones periféricas y Propósito General E/S (GPIO)
• 88F21/886811/88W F6F6821-48 pasadores de MPP dedicado para las funciones de periférico y Propósito General E/S (GPIO)
• Cada pin configurables de forma independiente
• GPIO entradas configurables para registrar las interrupciones de los dispositivos externos y generar interrupciones máscara
• Salidas GPIO configurable para el control PWM de LED o el funcionamiento del ventilador
La generación de reloj
• La generación interna de la CPU Core Clock, reloj, reloj SDRAM, RGMII/MII reloj, reloj SERDES, TDM reloj, reloj de audio, y reloj de referencia externa desde un único reloj de referencia de 25 MHz
• Compatible con la generación interna de Spread Spectrum Clocking en el subsistema de la CPU y la interfaz de SDRAM
Interrumpe
Compatible con el brazo de controlador de interrupciones de genéricos (GIC), la versión 1
Sensor térmico
En el chip sensor térmico con exceso de calor interrumpir
Temporizadores y contadores y temporizadores de Watchdog
Programable integrado 32/64 bits Temporizadores y contadores y temporizadores de watchdog
Paquete
88F F F68286810/886820/88-TFBGA 17x17 mm paquete, el tono de bola de 0,8 mm.
88F F F66821/886811/88W21-TFBGA 14x14 mm paquete, de 0,65 mm de paso de bola
Marvell Technology, Inc. es una empresa americana, con sede en Santa Clara, California, que desarrolla y produce semiconductores y la tecnología relacionada. Fundada en 1995, la compañía contaba con más de 6.000 empleados a partir de 2021, con más de 10.000 patentes en todo el mundo, y una tasa anual de ingresos de $4.5 millones de euros en 2021.
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4. Debido a la realidad de algún tiempo la volatilidad de los cambios de los chips y componentes de las existencias y precios, póngase en contacto con nosotros para su disponibilidad y precios de los presupuestos antes del pago.
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Perfil de empresa Telecomunicaciones TELEFLY Equipment Co., Ltd. es un destacado fabricante de equipos de telecomunicaciones de China y un chip semiconductor y otros distribuidor de componentes electrónicos fundada en 2004, certificado por SGS, las CFL Centro de Certificación. Ofrecemos alta calidad y precio competitivo chips semiconductores y otros componentes electrónicos, switch Ethernet ,transceptor SFP,Media converter ,patch cable divisor de fibra óptica, y así sucesivamente. Hasta ahora, nuestros productos y soluciones han sido desplegados en más de 60 países y regiones, TELEFLY espera fortalecer las relaciones de cooperación amistosa con todos los clientes, creando beneficios juntos y compartir la alegría de éxito! Nuestras ventajas
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2.El servicio de OEM con 13 años de experiencias, muestras gratis están disponibles.
3.La respuesta inmediata para cualquier pregunta e investigación en el menor tiempo posible.
4.directamente de fábrica, reducir sus costes y ahorrar tiempo.
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Q1 . Lo que su MOQ?
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La certificación Q2.Lo conseguiste ?
A2 : Nuestro producto estrictamente operar el sistema de control de calidad ISO9001:2008 y aprobamos la CE, FCC, RoHS y SGS test,usted puede confiar en nosotros.
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